A arquitetura RISC (Reduced Instruction Set Computer) apresenta um conjunto restrito de instruções, executadas de forma altamente eficiente. Uma das desvantagens desta arquitetura é:
A necessidade de conversão de código de alto nível em diversas instruções em Assembly, aumentando o número de instruções a serem executadas.
O aumento do uso de registradores.
A grande variedade de instruções disponíveis.
O aumento do consumo de energia do processador.
A grande necessidade de uso da memória.
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A necessidade de conversão de código de alto nível em diversas instruções em Assembly, aumentando o número de instruções a serem executadas.
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A necessidade de conversão de código de alto nível em diversas instruções em Assembly, aumentando o número de instruções a serem executadas
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